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多核處理器設計優(yōu)化——低功耗、高可靠、易測試 
定 價：158 元
9 7 6 8 7 7 1 0 4 3 7 0 9 讀者對象:本書可作為集成電路工程技術人員的參考書。本書所講述的技術和方法，可以用于多核處理器體系結構的低功耗設計中，為邏輯設計，驗證，測試提供技術參考，為集成電路工程設計人員提供多角度的解決方案。
本書主要內容涉及多核處理器設計優(yōu)化的三個方面：低功耗、高可靠和易測試；從處理器核、片上互連網絡和內存系統(tǒng)三個方面論述多核處理器設計的低功耗和高可靠優(yōu)化方法；從邏輯電路的可測試性體系結構以及存儲器電路的自測試方面論述多核處理器的可測試性設計方法；從新型三維堆疊架構以及異構數據中心系統(tǒng)層面論述多核處理器的能效提升方法；并以中國科學院計算技術研究所自主研發(fā)的DPU-M多核處理器為例，介紹相關成果的應用。
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