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《Verilog HDL數(shù)字系統(tǒng)設(shè)計(jì)原理與實(shí)踐》從應(yīng)用角度出發(fā)，詳細(xì)介紹了利用硬件描述語(yǔ)言進(jìn)行數(shù)字電路設(shè)計(jì)的基本原理、基本概念和設(shè)計(jì)方法，包括VerilogHDL語(yǔ)法基礎(chǔ)、組合邏輯電路、規(guī)則時(shí)序邏輯電路、有限狀態(tài)機(jī)及數(shù)據(jù)通道設(shè)計(jì)，靜態(tài)時(shí)序分析及跨時(shí)鐘域數(shù)據(jù)傳輸?shù)幕靖拍�、設(shè)計(jì)方法及應(yīng)用。全書通過(guò)大量、完整、規(guī)范的設(shè)計(jì)實(shí)例演示各類數(shù)字電路的設(shè)計(jì)過(guò)程和描述方法。每章配有習(xí)題，以指導(dǎo)讀者深入地進(jìn)行學(xué)習(xí)。本書既可以作為電子科學(xué)與技術(shù)、集成電路設(shè)計(jì)相關(guān)專業(yè)本科、研究生數(shù)字集成電路前端設(shè)計(jì)教材，也可作為電子信息、電氣工程和自動(dòng)化相關(guān)專業(yè)FPGA應(yīng)用設(shè)計(jì)課程教材使用。

前言
近年來(lái)，硬件描述語(yǔ)言（Hardware Description Language）逐漸取代傳統(tǒng)的設(shè)計(jì)方法，成為數(shù)字電路設(shè)計(jì)的主流方法。本書堅(jiān)持“用語(yǔ)言、講設(shè)計(jì)、重實(shí)踐”的建設(shè)思路，打破傳統(tǒng)教材以介紹硬件描述語(yǔ)言語(yǔ)法或者軟件使用為重點(diǎn)的傳統(tǒng)，以數(shù)字電路結(jié)構(gòu)為主線安排教學(xué)內(nèi)容，通過(guò)大量完整、規(guī)范的設(shè)計(jì)實(shí)例介紹基于Verilog HDL的寄存器傳輸級(jí)（Register Transfer Level，RTL）數(shù)字電路設(shè)計(jì)的基本概念和實(shí)現(xiàn)方法。
《Verilog HDL數(shù)字系統(tǒng)設(shè)計(jì)原理與實(shí)踐》從Verilog HDL基礎(chǔ)語(yǔ)法講起，由淺入深，系統(tǒng)地介紹組合邏輯電路設(shè)計(jì)、規(guī)則時(shí)序邏輯電路、有限狀態(tài)機(jī)、有限狀態(tài)機(jī)+數(shù)據(jù)通道、靜態(tài)時(shí)序分析和跨時(shí)鐘域設(shè)計(jì)的基本概念和實(shí)現(xiàn)方法；討論了數(shù)字電路結(jié)構(gòu)與面積、速度關(guān)系和優(yōu)化方法及Verilog HDL實(shí)現(xiàn)方式，內(nèi)容涵蓋數(shù)字電路（前端）設(shè)計(jì)的全部?jī)?nèi)容。書中對(duì)于數(shù)字電路基本原理和設(shè)計(jì)方法的描述，全部是通過(guò)難易程度不同的設(shè)計(jì)實(shí)例演示，大部分設(shè)計(jì)實(shí)例通過(guò)簡(jiǎn)單擴(kuò)展可以直接應(yīng)用于具體設(shè)計(jì)，具有很好的參考價(jià)值。《Verilog HDL數(shù)字系統(tǒng)設(shè)計(jì)原理與實(shí)踐》可以作為電子科學(xué)與技術(shù)、集成電路設(shè)計(jì)相關(guān)專業(yè)本科、研究生數(shù)字集成電路前端設(shè)計(jì)基礎(chǔ)教材使用，也可作為電子信息、電氣工程和自動(dòng)化相關(guān)專業(yè)教授FPGA應(yīng)用設(shè)計(jì)課程教材使用。對(duì)于有經(jīng)驗(yàn)的數(shù)字電路設(shè)計(jì)工程師也會(huì)有一定的參考價(jià)值。
書中全部設(shè)計(jì)實(shí)例在Quartus II 130和ModelSim 102軟件環(huán)境下編譯通過(guò)，授課教師在教學(xué)過(guò)程中可酌情考慮取舍。建議授課學(xué)時(shí)：48學(xué)時(shí)；實(shí)驗(yàn)學(xué)時(shí)：16學(xué)時(shí)。授課教師可以通過(guò)wjmfuzzy@126com郵箱，申請(qǐng)本教材配套的CAI課件、習(xí)題答案、實(shí)驗(yàn)指導(dǎo)書及實(shí)驗(yàn)源代碼。由于綜合軟件限制，本書元器件符號(hào)采用ANSI/IEEE標(biāo)準(zhǔn)，與國(guó)際符號(hào)的對(duì)照表見(jiàn)附錄B。
研究生蘭風(fēng)宇、崔新瑩和姚博文校對(duì)了部分書稿和代碼，李曉和李喆繪制了部分插圖，在此表示真誠(chéng)的感謝。感謝機(jī)械工業(yè)出版社時(shí)靜編輯在《Verilog HDL數(shù)字系統(tǒng)設(shè)計(jì)原理與實(shí)踐》出版過(guò)程中給予的無(wú)私幫助。
由于時(shí)間倉(cāng)促，書中難免存在不妥之處，請(qǐng)讀者原諒，并提出寶貴意見(jiàn)。
作者

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