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電子線路CAD與優(yōu)化設計——基于Cadence/PSpice

電子線路CAD與優(yōu)化設計——基于Cadence/PSpice

定  價:46 元

        

  • 作者:賈新章等
  • 出版時間:2014/4/1
  • ISBN:9787121226205
  • 出 版 社:電子工業(yè)出版社
  • 中圖法分類:TN702 
  • 頁碼:336
  • 紙張:膠版紙
  • 版次:1
  • 開本:16開
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本書在闡述電子線路CAD和優(yōu)化設計技術基本概念的基礎上,結合目前在電子設計領域廣泛使用的Cadence/PSpice軟件的最新版本16.6,介紹CAD和優(yōu)化設計的基本原理及相關軟件工具的使用方法,包括電路圖設計模塊Capture、電路基本特性模擬軟件PSpice AD、電路高級分析工具PSpice AA,以及與MATLAB/ Simulink相結合進行行為級和電路級協(xié)同模擬仿真的模塊SLPS。
本書在介紹Cadence/PSpice 16.6 軟件的功能和使用方法時,不但結合具體實例,而且對于初學者難以理解的概念和容易發(fā)生的問題,特別給予詳細的說明。為了方便讀者上機練習,本書還提供下載PSpice 16.6的演示版軟件及本書電路實例的網頁地址。
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