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Vivado入門(mén)與FPGA設(shè)計(jì)實(shí)例

Vivado入門(mén)與FPGA設(shè)計(jì)實(shí)例

定  價(jià):48 元

叢書(shū)名:高等學(xué)校計(jì)算機(jī)基礎(chǔ)教育教材精選

        

  • 作者:廉玉欣 等
  • 出版時(shí)間:2018/9/1
  • ISBN:9787121347689
  • 出 版 社:電子工業(yè)出版社
  • 中圖法分類:TP332.1 
  • 頁(yè)碼:288
  • 紙張:
  • 版次:01
  • 開(kāi)本:16開(kāi)
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讀者對(duì)象:本書(shū)可作為高等工科院校電類專業(yè)和機(jī)械等非電類專業(yè)教材,也可供高職高專院校使用,此外從事電子電路設(shè)計(jì)的工程技術(shù)人員也可以參閱本書(shū)。

本書(shū)以Xilinx公司的Vivado FPGA設(shè)計(jì)套件為軟件平臺(tái),以依元素科技有限公司的EGO1 Aritix-7實(shí)驗(yàn)板卡為硬件平臺(tái),將硬件描述語(yǔ)言Verilog HDL與FPGA設(shè)計(jì)實(shí)例相結(jié)合,系統(tǒng)介紹了利用Vivado和Verilog HDL進(jìn)行數(shù)字電路設(shè)計(jì)和FPGA開(kāi)發(fā)的方法與流程。 本書(shū)主要內(nèi)容包括硬件開(kāi)發(fā)平臺(tái)介紹、Vivado軟件平臺(tái)介紹、FPGA設(shè)計(jì)實(shí)例、組合邏輯電路設(shè)計(jì)實(shí)例、時(shí)序邏輯電路設(shè)計(jì)實(shí)例、數(shù)字邏輯設(shè)計(jì)和接口實(shí)例及數(shù)字邏輯綜合實(shí)驗(yàn)。本書(shū)將Verilog HDL的語(yǔ)法講解融入大量的FPGA設(shè)計(jì)實(shí)例中,內(nèi)容由淺入深、循序漸進(jìn)、系統(tǒng)全面,易于讀者掌握Verilog HDL和FPGA設(shè)計(jì)方法。
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